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编辑设计一个同步时序逻辑电路，当输入信号X=0时，按二进制规律递增计数：当输入信号X=1时，按循环码计数，其状态转换图如图(a)所示。要求用两个如图(b)所示的JK触发器及若干与或非门实现，且电路最简。
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